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  1. 2023.05.14 altera uart ip
  2. 2023.04.24 altera - partial reconfigure
  3. 2023.03.28 altera nios 2 epcs to ram
  4. 2021.11.01 Nios V
  5. 2021.07.06 IOFS - Intel Open FPGA Stack
  6. 2021.04.06 oneAPI Quartus pro 필요?
  7. 2021.03.26 cyclone V openCL?
  8. 2021.03.09 risc v on fpga
  9. 2020.06.23 quartus II 9.0이 아니야? 4.2 설치!
  10. 2020.06.22 큰 맘 먹고 질렀으나..
embeded/FPGA - ALTERA2023. 5. 14. 12:56

altera uart ip

xilinx 에서 보다 intel fpga쪽 보니

라이센스 이야기도 없고(그냥 있으면 기본 무료라고 보면 되는건가..?) 웬지 불안해지는 느낌

 

얘가 HDL 레벨에서 설정해서 쓰는 간단한 uart ip고

 

16550 이 전체 사양 지원하는 uart 디바이스

 

 

cyclone iv 에서는 사용불가능한데

이름만 보면 xlinix의 uartlite 같지만, 전혀 다른 ip 같은 느낌이네..

그 와중에 시리얼 라이트라는데 내가 아는 그 시리얼이 아닌가?

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Posted by 구차니
embeded/FPGA - ALTERA2023. 4. 24. 13:56

altera - partial reconfigure

 Arria 10 HPS에서만 되는진 찾아봐야 할 듯.

Partial reconfiguration (PR) allows you to reconfigure a portion of the FPGA dynamically, while the remaining FPGA design continues to function

[링크 : https://cdrdv2-public.intel.com/667007/an798-683034-667007.pdf]

 

어째 느낌이 HPS 라인업만 되는 것 같네?

그와중에 SC로 끝나야 해당 기능을 사용할 수 있다고..

The Intel® Quartus® Prime software supports the PR feature for the Intel® Stratix® V device family and Cyclone® V devices whose part number ends in "SC", for example, 5CGXFC9E6F35I8NSC.

[링크 : https://www.intel.com/content/www/us/en/docs/programmable/683499/18-1/design-planning-for-partial-reconfiguration.html]

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Posted by 구차니
embeded/FPGA - ALTERA2023. 3. 28. 19:45

altera nios 2 epcs to ram

 

2. Executable code is stored in the EPCS. This is according to your second attempt: 
 
--- Quote Start ---  
I changed the reset vector to EPCS controller, it still doesn't work 
--- Quote End ---  
 
In this case the epcs_flash_controller is nesessary in your system. The reset vector must point to the epcs_flash_controller, which contains the bootcopier code. The exeption vector must point to On-Chip RAM because your .text segment is still located there. 
After power is up, NiosII start the execution of the bootcopier code from epcs_flash_controller internal ROM. This bootcopier gets application executible code from EPCS and stores it into On-Chip RAM. After bootcopier has finished its work the control passes to the application executible code in the On-Chip RAM.

[링크 : https://community.intel.com/t5/Nios-II-Embedded-Design-Suite/how-to-embeded-the-Nios-software-into-FPGA-sof-file/m-p/150842]

 

1.5.5. Nios II Processor Application Copied from EPCS Flash to RAM Using Boot Copier
The EPCS address space is not mapped into the Altera Avalon EPCS Flash Controller’s Avalon MM slave interface. Instead, read or write accesses are done through CSRs. Upon system reset, the EPCS device needs to be initialized before usage.

For these reasons, the EPCS controller-based boot copier is required for initializing the EPCS device and copying the Nios II application to RAM for execution.

The EPCS controller instantiates a block of boot ROM internally at its base address (offset 0x0, just before EPCS controller’s CSRs) for storing the boot copier. Nios II reset vector offset must set to EPCS controller base address, such that upon system reset the boot copier is executed first to initialize the EPCS controller and device.

[링크 : https://www.intel.com/content/www/us/en/docs/programmable/683820/current/nios-ii-processor-application-copied-37722.html]

[링크 : https://manuals.plus/ko/Intel/1-5-1-nios-ii-booting-general-flow-manual#axzz7xFS1je7Y]

 

Nios® II 플래시 프로그래머를 사용할 때 --csr 옵션은 무엇입니까?

설명
직렬 플래시 컨트롤러 II IP와 함께 Nios II 플래시 프로그래머(현재 "quartus_pgm --nios2")를 디자인에 사용할 때 명령 문자열에 새로운 옵션 "--csr"를 지정해야 합니다.

해결 방법
--csr 옵션은 직렬 플래시 컨트롤러 II IP 코어의 "avl_csr" 인터페이스 주소로 지정되어야 합니다.  예를 들어 플랫폼 디자이너 시스템에서 "avl_csr" 인터페이스의 주소 범위가 0x1000_0000 0x1000_003F 경우 "--csr=0x10000000"을 사용하십시오.

이 기능은 Nios II 플래시 프로그래머 사용자 가이드의 향후 버전에서 완전히 문서화될 것으로 예상됩니다.

[링크 : https://www.intel.co.kr/content/www/kr/ko/support/programmable/articles/000086366.html]

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Posted by 구차니
embeded/FPGA - ALTERA2021. 11. 1. 15:11

Nios V

altera/intel fpga의 soft mcu가 risc-v 채택해서 nios V로 제공되는데

[링크 : https://www.intel.com/content/www/us/en/products/details/fpga/nios-processor/v.html]

 

하드웨어 요구사항이 높네.. 아쉽게도 내가 가징 de0-nano의 cyclone IV로는 무리인듯.

2.1. Hardware and Software Requirements

Intel uses the following hardware and software to build a Nios® V/m processor system:
  • Supported Intel FPGA devices:
    • Intel® Cyclone® 10 GX
    • Intel® Arria® 10
    • Intel® Stratix® 10
    • Intel® Agilex™
  • Intel® Quartus® Prime Pro Edition software version 21.3 or later

[링크 : https://www.intel.com/content/www/us/en/programmable/documentation/jmv1629188568604.html]

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Posted by 구차니
embeded/FPGA - ALTERA2021. 7. 6. 10:50

IOFS - Intel Open FPGA Stack

oneAPI 세미나 질문중 받은 키워드

아무튼.. custom IOFS를 통해 독립 cyclone 칩도 가능은 하나

pci-e로 호스트와 연결이 되어 있어야 한다고.. 흐음...

그냥 쓰지 못한다는 말로 들리는구만 ㅠㅠ

[링크 : https://www.hellot.net/mobile/article.html?no=55317]

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Posted by 구차니
embeded/FPGA - ALTERA2021. 4. 6. 17:06

oneAPI Quartus pro 필요?

Q: DE10-Nano에서 oneAPI 하려는데 안되요~

A: Quartus Pro 사세요

As of now OneAPI addon is supported in Quartus Pro only.

[링크 : https://community.intel.com/.../Local-OneAPI-FPGA-synthesis-with-Altera-Cyclone-5/td-p/1204639]

 

근데.. pro는 비싸지 않나...

그리고 addon 이라고 하면.. addon이 아닌 상태로는 lite로도 가능하다는 건가?

 

지원되는 하드웨어에... Arria 10GX / Stratix 10SX 가 포함된 PC 카드 타입..

Supported Hardware
FPGA Cards
Intel® Programmable Acceleration Card (PAC) with Intel® Arria® 10 GX FPGA with Intel® Acceleration Stack for Intel® Xeon® CPU with FPGAs Version 1.2.1
Intel® FPGA Programmable Acceleration Card D5005 (previously known as Intel® PAC with Intel® Stratix® 10 SX FPGA) with Intel® Acceleration Stack for Intel® Xeon® CPU with FPGAs Version 2.0.1
Custom Platforms (Ported from Intel® Arria® 10 GX and Intel® Stratix® 10 GX reference platforms)
Intel® Custom Platforms with Intel® Quartus® Prime software version 20.4
Intel® Custom Platforms with Intel® Quartus® Prime software version 20.3
Intel® Custom Platforms with Intel® Quartus® Prime software version 20.2
Intel® Custom Platforms with Intel® Quartus® Prime software version 19.4

[링크 : https://software.intel.com/.../intel-oneapi-dpcpp-fpga-add-on-release-notes.html]

 

혹시나 저렴한(!) DE10-Nano로는 안되나 찾아봐야 하는데.. 위에 링크에서 일단 좌절중!

 

그래도 모르니 Standard와 Nano를 비교해보니 cyclone V SE와 SX의 차이라..

DE10-Standard Cyclone V SX SoC—5CSXFC6D6F31C6N (110K LEs, 41509 ALMs

[링크 : https://www.terasic.com.tw/cgi-bin/page/archive.pl?Language=English&CategoryNo=165&No=1081&PartNo=2]

DE10-Nano Intel Cyclone® V SE 5CSEBA6U23I7  device (110K LEs)

[링크 : https://www.terasic.com.tw/cgi-bin/page/archive.pl?Language=English&CategoryNo=167&No=1046&PartNo=2]

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Posted by 구차니
embeded/FPGA - ALTERA2021. 3. 26. 10:20

cyclone V openCL?

문득 zynq에 대응되는 cyclone V를 찾아보다 보니 뜬금없이 보이는 openCL

읭? 그런데 동일 코어일텐데 왜 하나는 openCL이고 다른건 없을까?

[링크 : https://www.terasic.com.tw/cgi-bin/page/archive.pl?Language=English&CategoryNo=163#Category165]

  [링크 : https://www.terasic.com.tw/cgi-bin/page/archive.pl?Language=English&CategoryNo=167&No=1046]

  [링크 : https://www.terasic.com.tw/cgi-bin/page/archive.pl?Language=English&CategoryNo=167&No=941]

 

[링크 : https://www.intel.com/content/www/us/en/programmable/documentation/ewa1400875619714.html]

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Posted by 구차니
embeded/FPGA - ALTERA2021. 3. 9. 20:25

risc v on fpga

cyclone iv 에 모든 버전 사용가능.

de0 nano 간만에 살랴봐야하나

 

[링크 : http://github.com/maikmerten/riscv-tomthumb]

[링크 : http://github.com/open-design/riscv-soc-cores]

[링크 : http://github.com/SpinalHDL/VexRiscv]

 

 

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Posted by 구차니
embeded/FPGA - ALTERA2020. 6. 23. 09:11

quartus II 9.0이 아니야? 4.2 설치!

읭.. 생성은 4.0 대에서 했던 듯?

 

 

예 누르고 넘어가는데

헐.. 어느 버전을 써야 하나?

 

 

+

검색하다 보니 excalibur는 4.2 버전까지라고.. ㄷㄷ

HBE-SoC-Entry에서 사용되는 EXCALIBUR의 디바이스의 경우 Quartus II 4.2까지만 지원을 하고 있습니다.

따라서, 4.0 또는 4.2 버전으로 사용해야 합니다.

이 버전의 경우 Windows 7까지 사용하여 보았으며,

USB Blaster의 드라이버는 최신 버전의 Quartus II의 드라이버를 추출하여 사용하시면 됩니다.

[링크 : http://www.hanback.kr/insiter.php?design_file=3012.php&article_num=11627&OTSKIN=layout_ptr.php]

 

+

4.2 설치하고 나니 되긴 한다. 라이센스를 따로 받아야 하는 귀찮음이 발생하네..

 

SOPC builder 실행하니 JVM 에러가 나네?

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Posted by 구차니
embeded/FPGA - ALTERA2020. 6. 22. 21:42

큰 맘 먹고 질렀으나..

이거 웬지 자료가 없어서 쓰레기가 될 느낌이 농후해지는 중

 

HBE-Combo-D1은 JTAG 핀없이 패러럴로만 있어서 요즘 LPT가 없는 시스템에서 쓰기 너무 힘들 것 같아서 패스하고

SoCMaster-XP100 와 Hybus X-Hyper320TKU 중에 고민을 했는데

 

Hybus X-Hyper320TKY의 IEB 보드는 비표준 사이즈의 JTAG을 쓰고 있어서 일단 패스

(Byte Blaster라고 패러럴 포트로 되어있어서 먼가 작업을 하면 가능은 하겠지만.. 귀찮...)

그리고 다른분이 10개 사가셨다는데 거기에는 CD 있었다는거 같은데

내가 보러 가서는 CD가 없어서 구글링 해도 자료가 없는지라 포기.

 

SoCMaster는 표준 2.54mm pitch 10핀 JTAG을 쓰고 있어서 추가 작업없이 

저렴한 USB Blaster를 통해서 구울수 있어 낼름 겟!

CD는 있는데 집에와서 보니 별다른 자료는 없고 소스코드와 데이터 시트뿐이라

어떤 교육자료를 조금 기대했던 나로서는 3만원만 날리는 게 되는거 아닌가 라는 불안감이 엄습중..

 

+

흐음.. 고민이네..

 

[링크 : https://www.aladin.co.kr/shop/wproduct.aspx?ItemId=223418718] 책 16000 + 2500

[링크 : http://itempage3.auction.co.kr/DetailView.aspx?itemno=B439033929] USB blaster 6460 +2500

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