'이론 관련'에 해당되는 글 172건

  1. 2018.05.30 VGA Pattern Generator 관련 검색
  2. 2018.05.29 hdmi pinout
  3. 2018.05.29 VGA 관련 자료 검색중
  4. 2018.05.23 rs-422 / rs-485
  5. 2018.05.15 자이로 드리프트
  6. 2018.05.14 balanced unbalanced
  7. 2018.05.02 uart 2bit stop bit
  8. 2018.05.02 MFCCs - Mel-frequency cepstral coefficients
  9. 2018.04.24 I2c smbus slave interrupt
  10. 2018.04.22 용어 정리

픽셀 클럭 등등등.. 막 쑤셔 넣음..


front-back porch

[링크 : http://web.mit.edu/6.111/www/s2004/NEWKIT/vga.shtml]

[링크 : https://nathandumont.com/blog/vga-primer]

[링크 : https://eewiki.net/pages/viewpage.action?pageId=15925278]


[링크 : http://www.eng.ucy.ac.cy/theocharides/Courses/ECE664/VGA.pdf]

[링크 : https://timetoexplore.net/blog/video-timings-vga-720p-1080p] + EDID

[링크 : http://martin.hinner.info/vga/timing.html]

[링크 : http://tinyvga.com/vga-timing]

[링크 : http://www.ni.com/white-paper/4750/ko/]

[링크 : http://monitorinsider.com/cable_bandwidth.html]

[링크 : https://www.monitortests.com/pixelclock.php] << 계산기.. 쓰는법 모르겠음


[링크 : http://forum.falinux.com/zbxe/?document_srl=562729&mid=lecture_tip&page=3]


[링크 : https://en.wikipedia.org/wiki/Broadcast_television_systems]

[링크 : https://en.wikipedia.org/wiki/Horizontal_blanking_interval]

[링크 : https://en.wikipedia.org/wiki/Vertical_blanking_interval]


+

H/Vsync는 5V이긴 한데 3.3V 상관없나?

[링크 : http://www.javiervalcarce.eu/html/vga-signal-format-timming-specs-en.html]

[링크 : https://electronics.stackexchange.com/.../programming-pattern-to-generate-vga-signal-with-micro-controller]


+

ATmega88로 만들기 ㄷㄷ

[링크 : https://www-user.tu-chemnitz.de/~heha/Mikrocontroller/VgaGen/VgaGen.en.htm]

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Posted by 구차니

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HDMI 핀 배열 및 신호 관련 정보 검색


[링크 : http://pinouts.ru/visual/gen/hdmi.jpg]

[링크 : http://pinouts.ru/Video/hdmi_pinout.shtml]


TMDS는 0/1/2+CLK로 구성되고

CEC와 DDC 그리고 Hotplug 및 5V 전원이 공급된다.

Pins 1 through 9 carry the three TMDS data channels (Transition Minimized Differential Signaling – the technology that allows DVI and HDMI to send high-speed digital data), three pins per channel. TMDS data includes both video and audio information, and each channel has three separate lines for + values, - values, and a ground or data shield.


Pins 10 through 12 carry data for the TMDS clock channel, which helps keep the signals in synchronization. As with the TMDS data channels, there are separate lines for + values, - values, and a data shield.


Pin 13 is carries the CEC (Consumer Electronics Control) channel, used for sending command and control data between connected devices.


Pin 14 is reserved for future use.


Pins 15 and 16 are dedicated to the DDC (Display Data Channel), used for communicating EDID (Extended Display Identification Channel) information between devices.


Pin 17 is a data shield for the CEC and DDC channels.


Pin 18 carries a low-voltage (+5V) power supply.


Pin 19 is the Hot Plug Detect, dedicated to monitoring power up/down and plug/unplug events. 

[링크 : https://www.hdmi.org/installers/insidehdmicable.aspx]


데이터는 8b/10b로 인코딩 됨

Both HDMI and DVI use TMDS to send 10-bit characters that are encoded using 8b/10b encoding

[링크 : https://en.wikipedia.org/wiki/HDMI]


2.8V~3.3V로 표현.. TMDS니까 디퍼런셜 라인의 경우 어떻게 표현되려나?

디지털이니까 0과 1만 뒤집어 주면 되려나?

Basics

 HDMI leverages on the successful transition minimized differential signaling (TMDS) technology. The differential signals are +3.3 Volts, terminated in 50 Ω with nominal amplitude transitions of 500 mV (+2.8 V to +3.3 V). The voltage swing can vary from 150 mV to 800 mV. The signals have rise times of the order of 100 ps 

[링크 : http://download.tek.com/document/61W_17974_6_HR_Letter_0.pdf]


6.2.2 Video Control Signals : HSYNC, VSYNC

During the Data Island period, HDMI carries HSYNC and VSYNC signals using encoded bits on Channel 0. During Video Data periods, HDMI does not carry HSYNC and VSYNC and the Sink should assume that these signals remain constant. During Control periods, HDMI carries HSYNC and VSYNC signals through the use of four different control characters on TMDS Channel 0. 

[링크 : http://d1.amobbs.com/bbs_upload782111/files_51/ourdev_716302E34B9Q.pdf]


BGR 순서로 채널이 배정되는게 맞는 듯?

[링크 : http://www.wireworldcable.co.uk/hdmi_tech.html]


[링크 : https://www.cablestogo.com/learning/library/digital-signage/intro-to-tmds]

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Posted by 구차니

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640*480에 대한 VHDL 코드 인듯?

0.1 + 0.2 + 0.4V 합치면 0.7V 니까.. 3비트 씩 해서 8(2^3)  * 8 * 8 = 512 컬러 인가?

A VGA video signal contains 5 active signals:

• horizontal sync: digital signal, used for synchronisation of the video

• vertical sync: digital signal, used for synchronisation of the video

• red (R): analog signal (0-0.7 v), used to control the color

• green (G): analog signal (0-0.7 v), used to control the color

• blue (B): analog signal (0-0.7 v), used to control the color 

흐음.. 이건 어떻게 해석을 해야 하나?


[링크 : http://lslwww.epfl.ch/pages/teaching/cours_lsl/ca_es/VGA.pdf]



요즘 사용하는건 I2C 들어간 DDC2 방식이라고 해야하나?

[링크 : https://en.wikipedia.org/wiki/Display_Data_Channel]

[링크 : http://pinouts.ru/Video/VGA15_pinout.shtml]

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485 컨버터가 대개 422도 겸용하고 있어서 왜 그랬나 몰랐는데

데이터시트 뒤지다 보니.. 422은 485의 서브셋이라고..


Application Information

RS-485 and RS-422 are differential (balanced) data transmission standards for use in long haul or noisy environments. RS-422 is a subset of RS-485, so RS-485 transceivers are also RS-422 compliant

[링크 : https://www.intersil.com/.../isl3170e-71e-72e-73e-74e-75e-76e-77e-78e.pdf]


422이나 485나 둘다 Differential 방식으로 동작하고 (485는 아닌줄 알았는데.. ㄷㄷ)

485는 Half-duplex

422은 Full-duplex를 지원한다.



+

485 파형

[링크 : https://www.maximintegrated.com/en/app-notes/index.mvp/id/723]

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Posted by 구차니

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자이로 센서는 각속도를 재는 애고

센서의 한계와 적분오차로 인해서 한곳으로 수렴하게 되는데

아마 VR을 사용시에 아래나 위로 쳐박히는 이유가 자이로 드리프트 라는 현상 떄문인듯?


[링크 : http://hs36.tistory.com/32]

[링크 : http://pinkwink.kr/78]


동영상을 보니 내가 경험한 것은 적분 오차인 거지

자이로 드리프트는 아니었던 듯

[링크 : https://www.youtube.com/watch?v=KyXEVN7X43U]

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밸런스드 이거 디퍼런셜 아닌가?

[링크 : http://goldenears.net/board/ST_KB_byGE/7583]


맞으면서 아니라는 이 기묘한 내용은 머지 ㅠㅠ

밸런스드 시그널링은 그라운드와 동일한 임피던스를 지닌 (쉴드가 있거나 없거나) 두개의 도체

디퍼런셜 시그널링은 반대 극성으로 동일 신호를 전송하는 (쉴드가 있거나 없거나) 두개의 도체

Balanced signaling is two conductors (with an optional shield) that have equal impedance to ground.

Differential signaling is two conductors (with an optional shield) transmitting the same signal at opposite polarity. 

[링크 : http://www.hairballaudio.com/blog/resources/diy-resources/balanced-and-differential]

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Synchronization bits (동기화 비트)


Synchronization bits 는 2개 혹은 3개의 특수한 비트로 전송되는 데이터 패킷의 시작과 끝을 알립니다. 위 그림에서 start bit, stop bit가 해당됩니다. Start bit 는 1 bit, stop bit 는 1~2 bit 로 설정할 수 있습니다. (일반적으로 stop bit는 1bit를 사용)


Start bit 는 idle 상태(데이터 전송이 없는 상태)에서 active 상태로의 변화(1–>0)로 표시되며 stop 비트는 반대로 idle 상태로 변화함(1)을 의미합니다.

[링크 : http://www.hardcopyworld.com/ngine/aduino/index.php/archives/2080]

[링크 : https://en.wikipedia.org/wiki/Universal_asynchronous_receiver-transmitter]




The Model 33 used the seven-bit upper-case only ASCII code, also known as CCITT International Telegraphic Alphabet No. 5, with one (even) parity bit and two stop bits. The Model 33 is usually geared to run at maximum speed ten characters per second speed, i.e., 100 words per minute (wpm), but other speeds are available: 60 wpm, 66 wpm, 68.2 wpm, and 75 wpm.[9] There were also many typewheel options. The Teletype Parts Bulletin[10] lists sixty-nine available Model 33 typewheel options. 

[링크 : https://en.wikipedia.org/wiki/Teletype_Model_33]

    [링크 : https://electronics.stackexchange.com/questions/29945/one-or-two-uart-stop-bits]



1.5 stop bit

[링크 : https://electronics.stackexchange.com/questions/78788/what-is-the-meaning-of-half-bit-in-this-context]


START는 HIGH에서 LOW로 해주는 0

STOP은 LOW에서 HIGH로 해주는 1이기에

2bit STOP 역시 0b11로 표기된다.


[링크 : http://www.circuitgrove.com/tutorials/uart-universal-asynchronous-receivertransmitter]

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Posted by 구차니

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음성 인식 관련 알고리즘..


[링크 : https://blog.naver.com/mylogic/220988857132]

[링크 : https://en.wikipedia.org/wiki/Mel-frequency_cepstrum]

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I2C slave에서 마스터로 전송할 데이터가 생길 경우에는

폴링을 기다리거나, 마스터로 연결된 interrupt 핀이 있어야 한다.


Case 1: Slave has an interrupt pin


You need to connect this interrupt pin to master microcontroller. Every time the slave has some data, it should raise an interrupt. At that point, master will read the available data.


Case 2: Slave doesn't have an interrupt pin


Polling is the only option in this case. Master keeps reading all the slaves at regular interval and keeps comparing the received data with old one. If the data has changed, master will take appropriate action. You need to decide the interval according to your application. 

[링크 : https://electronics.stackexchange.com/questions/307630/slave-wants-to-send-data-to-master-in-i2c/307641]



다만 SMBUS에서는

slave가 mater 처럼 작동하여 호스트(0x08)에게 자신의 주소와 2바이트 정보는 던질 수 있도록 되어있다.

아니면 SMBALERT# 시그널을 통해 주의를 요청인데 이게 인터럽트 라인인 듯?

Arbitration in SMBus

Although conceptually a single-master bus, a slave device that supports the "host notify protocol" acts as a master to perform the notification. It seizes the bus and writes a 3-byte message to the reserved "SMBus Host" address (0x08), passing its address and two bytes of data. When two slaves try to notify the host at the same time, one of them will lose arbitration and need to retry.

An alternative slave notification system uses the separate SMBALERT# signal to request attention. In this case, the host performs a 1-byte read from the reserved "SMBus Alert Response Address" (0x0c), which is a kind of broadcast address. All alerting slaves respond with a data bytes containing their own address. When the slave successfully transmits its own address (winning arbitration against others) it stops raising that interrupt. In both this and the preceding case, arbitration ensures that one slave's message will be received, and the others will know they must retry.

SMBus also supports an "address resolution protocol", wherein devices return a 16-byte "universal device ID" (UDID). Multiple devices may respond; the one with the least UDID will win arbitration and be recognized. 

[링크 : http://www.microchip.com/forums/m/tm.aspx?m=795577&p=1]

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Simple PLD - SPLD ?

Complex PLD - CPLD


GAL : Generic Logic Array

PAL :  Programmable Array Logic

PLD : Programmable Logic Device

CPLD : Complex Programmable Logic Device

FPGA : Field Programmable Gate Array 

[링크 : https://www.embeddedrelated.com/showthread/comp.arch.embedded/9278-1.php]

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